おいふぉりーのぶろぐ

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Verilog の暗黙のネットを無効にする

Verilog では、宣言なしのワイヤーを使えるので、ミスタイプしたときに思ったように動かなくて困ります。(VB みたいな感じですね)
昨日、 FPGA をたたいてる友人が嘆いていたので、回避方法を紹介です。

`default_nettype none

と書くと、それ以降のコードではワイヤーの宣言が強制されます。これで解決です。
(VB の Option Explicit みたいな感じですね)
  1. 2008/06/26(木) 07:06:39|
  2. ハードウェア開発
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